5to Laboratorio
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APELLIDOS Y NOMBRES:
Ypanaque Segovia, Bryam Eduardo 20170078E
Babilonia Risco, Adriana 20162603G
Bravo Benites, Karen Alexandra 20172144E
DOCENTE:
Ing. Robinson Arévalo Macedo
CURSO-SECCIÓN:
Análisis y Diseño de Circuitos Electrónicos – ML 831 – B
INSTITUCIÓN:
Universidad Nacional de Ingeniería
FECHA DE PRESENTACIÓN:
03-05-2019
2019 - I
Facultad de Ingeniería Mecánica
2019-I
ÍNDICE
1. OBJETIVOS……….……………………...…..……....…......……………………………………..……….2
2. FUNDAMENTO TEÓRICO..………..……………………...……………..…..…………………..……….2
4. MATERIALES..……….……………………….………………..…..…………………..…………………..7
5. PROCEDIMIENTOS Y RESULTADOS..……..…………………………………..…..………………….7
6. CONCLUSIONES Y OBSERVACIONES..…………......…………………..……………..…..……….12
7. REFERENCIAS BIBLIOGRÁFICAS..……….…………………………..…..……..…………..……….12
1. OBJETIVOS:
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El JFET es un dispositivo de tres terminales controlado por voltaje, con una terminal capaz de
controlar la corriente entre las otras dos. Los FET son más estables a la temperatura que los BJT, y
en general son más pequeños que los BJT, lo que los hace particularmente útiles en chips de circuitos
integrados (CI).
Sin potenciales aplicados, el JFET tiene dos uniones p-n en condiciones sin polarización. El resultado
es una región de empobrecimiento en cada unión, como se muestra en la figura 1, la cual se asemeja
a la misma región de un diodo en condiciones sin polarización. Recuerde también que una región de
empobrecimiento no contiene portadores libres, y por consiguiente es incapaz de conducir.
En la figura 2 se tiene la curva de características de los JFET canal n, haciendo mucho más fácil su
análisis.
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La corriente máxima se define como IDSS y ocurre cuando VGS = 0 y VDS ≥ |Vp|, en la región
óhmica.
Para los voltajes de la compuerta a la fuente VGS menores que (más negativos que) el nivel
de estrangulamiento, la corriente de drenaje es de 0 A (ID = 0 A), esta es la región de corte.
Para todos los niveles de VGS entre 0 V y el nivel de estrangulamiento, la corriente ID oscilará
entre IDSS y 0 A, respectivamente. A esta la llamamos la región de saturación.
Hay tres tipos de FET: JFET, MOSFET y MESFET. Los MOSFET se dividen aún más en tipo
empobrecimiento y tipo enriquecimiento. Los términos empobrecimiento y enriquecimiento definen
su modo básico de operación; el nombre MOSFET significa transistor de efecto de campo
semiconductor de oxido metálico. En un MOSFET tipo empobrecimiento, sus características son
parecidas a las de un JFET entre las condiciones de corte y saturación con IDSS y también
adicionalmente tiene las características que se extienden hasta la región de polaridad opuesta de
VGS.
CONSTRUCCIÓN BÁSICA
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dieléctrico, el cual establece campos eléctricos opuestos dentro del dieléctrico cuando se expone a
un campo externamente aplicado. El hecho de que la capa de SiO2 sea una capa aislante significa
que: No hay una conexión eléctrica entre la terminal de compuerta y el canal de un MOSFET.
Cuando el voltaje de la compuerta a la fuente se ajusta a 0 V por la conexión directa de una terminal
a la otra y se aplica un voltaje VDS del drenaje a la fuente. El resultado es la atracción del potencial
positivo en el drenaje por los electrones libres del canal n y la corriente semejante a la que se
establece a través del canal del JFET. De hecho, la corriente resultante con VGS = 0 V se sigue
etiquetando IDSS, como se muestra en la figura 4.
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Las características del MOSFET tipo enriquecimiento son muy diferentes de cualesquiera otras
obtenidas hasta ahora. La curva de transferencia no está definida por la ecuación de Shockley y la
corriente de drenaje ahora es la de corte hasta que el voltaje de la compuerta a la fuente alcance
una magnitud específica. En particular, el control de corriente en un dispositivo de canal n ahora se
ve afectado por un voltaje positivo de la compuerta a la fuente en lugar de por los voltajes negativos
encontrados en los JFET de canal n y en los MOSFET tipo empobrecimiento de canal n.
Las características de transferencia de un MOSFET tipo enriquecimiento están definidas por una
ecuación no lineal controlada por el voltaje de la compuerta a la fuente, el voltaje de umbral, y una
constante k definida por el dispositivo empleado. La gráfica resultante ID contra VGS se eleva
exponencialmente con los valores crecientes de VGS.
3. INFORME PREVIO:
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Canal N Canal P
TRANSISTORES MOSFET
Figura 1
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Figura 2
2. ¿Cómo se obtiene la curva de transferencia IO vs VGS indicando los puntos de operación y las
rectas de polarización Io (1 / Rs ).Vgs obtenidas de Vgs IoRs por inducción de la
curva? Aproximar los datos del JFET como son IDSS y Vp
4. Para el circuito de la figura 2 se pide los valores de ID y VDS. Datos: IDSS = 12 mA, Vp = - 4V.
180𝑘 𝑉𝐺𝑆 2
𝑉𝐺 = 420𝑘+180𝑘 × 20 = 6𝑉 𝐼𝐷 = 12 × 10−3 × (1 − ) .... (2)
−4
Luego:
𝑽𝑫𝑺 = 𝟑. 𝟗𝟕𝟖𝟐 𝑽
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4. MATERIALES:
5. PROCEDIMIENTOS Y RESULTADOS:
En el desarrollo de esta práctica emplearemos la definición de cada uno de los 2 primeros parámetros
para su medición práctica. También tomaremos algunas mediciones para obtener la curva de
transconductancia del JFET que emplearemos.
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5. CONCLUSIONES Y OBSERVACIONES:
6. REFERENCIAS BIBLIOGRÁFICAS:
[1] Facultad de Ingeniería Mecánica UNI. Guía de Laboratorio de Análisis y Diseño de Circuitos
Electrónicos. Pág.104-107.
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[2] Boylestad R.L., Nashelsky L.. Electrónica: Teoría de Circuitos. Sexta edición. Pearson Educación.
México. Pág. 368-392
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